fengbh/script_work
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script_work/me241100_svExample
History
fengbh a421c93452 add me241100_svExample
2024-12-09 15:12:06 +08:00
..
Makefile
add me241100_svExample
2024-12-09 15:12:06 +08:00
ReadMe.md
add me241100_svExample
2024-12-09 15:12:06 +08:00
signal.rc
add me241100_svExample
2024-12-09 15:12:06 +08:00
testbench.sv
add me241100_svExample
2024-12-09 15:12:06 +08:00

ReadMe.md

svExample

概述

使用vcs编译sv的简单例子。

需要准备好vcs+verdi的仿真环境。

特性

  • 生成波形
  • Makefile 管理

快速开始

一、仿真

make clean comp sim

二、查看波形

make verdi